- 自動フロー制御付き、10/100 IEEE 802.3イーサネットMAC (MIIおよびRMII)ハーフ/フルデュープレクス
- 内蔵フレーマとLIUを通じて、4つのT1/E1/J1ラインによるレイヤ1の逆多重化
- 最高7.75msの遅延差をサポート
- 最大4つのT1/E1/J1リンクによる総帯域幅
- OAM対応のT1/E1信号処理能力
- プログラマブルなFCSおよびインタフレーム挿入によってHDLC/LAPSをカプセル化
- CIRコントローラにより512kbps増分単位で割当て
- プログラマブルBERT
- 外付け16MB、100MHzのSDRAMバッファリング
- パラレルマイクロプロセッサインタフェース
- 1.8V、3.3V電源
- IEEE 1149.1 JTAGに対応
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