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DS26522
デュアルT1/E1/J1トランシーバ

デュアルトランシーバ、基板スペースと電力を削減


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ステータス
入手可能:生産中

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正誤表
  • 正誤表 DS26522 26522A1.pdf
  • アプリケーションノート
  • Application Note 301: Legacy T1/E1 8MHz Backplane Operation - DS26522 (English only)
  • Application Note 309: Interfacing to the Fractional T1 and E1 - DS26522 (English only)
  • Application Note 351: T1/E1 and T3/E3 Transformer Selection Guide - DS26522 (English only)
  • Application Note 561: Tech Brief 7: DS2152 and DS2154 8MHz System Clock Operation - DS26522 (English only)
  • Application Note 3894: DS26522 JTAG Scan Chain Mapping - DS26522 (English only)
  • Application Note 3968: How to Use the Bit-Error-Rate Tester (BERT) on the DS2652x STCs - DS26522 (English only)

    評価キット
  • DS26522DK

    デザインガイド
  • Communications (PDF)

    信頼性レポート
  • 信頼性レポート: DS26522.pdf (English only)

    ソフトウェア/モデル
  • DS26522 IBISモデル
  • DS26522 OrCAD 論理記号
  • DS26522 論理記号-XML形式
  • DS26522 BSDLモデル
  • DS26522 BSDLモデル

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    参考文献: 19-5012; 2009-11-12
    このページの最終更新日: 2009-11-12


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