- SerDes内蔵、18のSASエキスパンダPHY
- 各PHYは個別に1.5Gbpsまたは3.0Gbpsで動作可能
- SASファンアウトまたはエッジエキスパンダとして構成可能
- 非ブロッキングスイッチアーキテクチャ(任意のPHY間の接続)
- 経路指定テーブル(最大320の宛先アドレス)
- イニシエータおよびターゲット機能付きのSMPおよびSSP仮想PHY
- ローカル制御およびSES機能用の組込みエンクロージャ管理プロセッサ(Stanford-1、32ビットRISC)
- 4つの動作モード:パラレルマスタ、パラレルスレーブ、I²Cシリアルインタフェーススレーブ、およびSPI™マスタ
- 自動PHY速度検出およびネゴシエーション
- 内蔵のSTP/SATAブリッジ機能によってシリアルATAドライブをサポート(PHY当り1個)
- プログラマブルな出力デエンファシスおよび入力信号イコライゼーションレベル
- 可変ワイドポート対応
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